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测量仪表相关技术文章如何利用逻辑分析仪功能解决嵌入式系统设计中的难题
在新的嵌入式系统设计中，不但需要测试和调试2.5 GHz串行总线及其相关的高级协议，还要面临如何让32位传统总线工作在800 MHz高数据率下的问题，因此，复杂高速嵌入式系统的设计、开发、测试和调试面临着新的挑战，本文介绍如何利用最新的逻辑分析仪功能解决这些棘手问题。
要想成功开发一个新型嵌入式系统，上市时间和系统可靠性是两个最重要的因素，但现代嵌入式系统日益增大的复杂性使这一目标很难达成。传统的嵌入式系统结构包含各种组件和互连总线，总线通常有并行互连总线和标准外设总线。
如今的系统中除了引入RapidIO 和 PCI Express等新的高速串行互连和外设总线以外，并行总线在短期内仍将存在。于是，在新的嵌入式系统设计中，不但需要测试和调试新的2.5 GHz串行总线及其相关的高级协议，还要面临如何让32位的传统总线工作在今天800 MHz的高数据率下的问题。如今使用的传统总线带宽很宽，而且数据率已经接近铜质并行总线可达到的数据率上限。因此，新的复杂高速嵌入式系统的设计、开发、测试和调试就面临着新的挑战。这种挑战不仅限于高端计算和通信应用，在处理主流的信号（例如运行速度高达100 MHz的微处理器应用中的信号）或高端信号（例如一个数据率高于2.5 GS/s的PCI Express 串行数据流）时，工程师都可能面临这样的问题。
