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三,实验原理 ① 集成四位同步二进制加法计数器74ls161 74ls161的逻辑

三,实验原理 ① 集成四位同步二进制加法计数器74ls161 74ls161的逻辑

74ls161为二进制同步计数器,具有同步预置数、异步清零以及保持等功能。两片74ls161可设计一个24进制计数器。

74LS161时序图

74ls161制作24进制计数器设计

74LS161管脚及功能

74ls161制作24进制计数器设计

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74LS161功能

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74LS161功能表

从74LS161功能表功能表中可以知道,当清零端CR=“0”,计数器输出Q3、Q2、Q1、Q0立即为全“0”,这个时候为异步复位功能。当CR=“1”且LD=“0”时,在CP信号上升沿作用后,74LS161输出端Q3、Q2、Q1、Q0的状态分别与并行数据输入端D3,D2,D1,D0的状态一样,为同步置数功能。而只有当CR=LD=EP=ET=“1”、CP脉冲上升沿作用后,计数器加1。74LS161还有一个进位输出端CO,其逻辑关系是CO= Q0·Q1·Q2·Q3·CET。合理应用计数器的清零功能和置数功能,一片74LS161可以组成16进制以下的任意进制分频器。

电路图设计

74ls161制作24进制计数器设计

实现的功能

由00000001到00011000变化,一共有二十四个变化。

当到达00011000之后重新开始一轮计数,从00000001开始下一个二十四进制的循环。

 

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