对特别重要的信号线或局部单元实施地线包围的措施。可在如时钟信号、高速模拟信号等这些不易受到干扰的信号走线的同时在外围加上保护的地线，将要保护的信号线夹在中间。各类信号走线不能形成环路，地线也不能形成电流环路。如果产生环路布线电路，将在系统中产生很大的干扰。采用菊*链布线能有效的避免布线时形成环路。应该在每个集成电路块的附近设置一个或几个高频去耦电容。模拟地线、数字地线等接往公共地线时要用高频扼流环节。某些高速信号线应特殊处理：差分信号要求在同一层上且尽可能的靠近平行走线，差分信号线之间不允许插入任何信号，并要求等长。
高速信号布线应尽量避免分枝或形成树桩（Stub）。高频信号线走在表层容易产生较大的电磁辐射，将高频信号线布线在电源和地线之间，通过电源和底层对电磁波的吸收，所产生的辐射将减少很多。
2.2 高速时钟信号布线
时钟电路在数字电路中占有重要地位。C64xDSP是C6000平台的最新成员，它具有足够高的处理速度。C64xDSP的高速时钟可达到1.1GHz，为早期C62xDSP的lO倍。所以在未来的DSP现代电子系统应用设计中对时钟布线要求会越来越高。高速时钟信号线优先级最高，一般在布线时，需要优先考虑系统的主时钟信号线。高速时钟信号线信号频率高，要求走线尽量地短，保证信号的失真度最小。
高频时钟，对噪声干扰特别敏感。需要对高频时钟信号线进行保护和屏蔽，将干扰降到最小。
高频时钟（20MHz以上的时钟，或上升沿少于5ns的时钟）必须有地线护送，时钟的线宽至少10rail，护送地线的线宽至少20mil。高频信号线的保护地线两端必须由过孔与地层良好接触，且每5em左右要打过孔与地层相连；地线护送与数据线基本等长，推荐手工拉线；时钟发送侧必须串接一个22～220Q左右的阻尼电阻。高速时钟信号走线设计尽量设计在同一层上，高速时钟信号线周围尽量没有其他的干扰源和走线。高频时钟连线建议采用星型连接或采用点对点连接，采用T型连接要保证等臂长，尽量减少过孑L数量，在晶振或时钟芯片下需敷铜防止干扰。避免由这些线带来的信号噪声所产生的干扰。
在高速信号布线和高速时钟信号布线时，都要求走线时少打过孑L、少分枝，以免造成树桩，产生信号的反射和串绕。过孔和树桩（Stub）在高速PCB中的影响，不仅反映在对信号的影响，同时也导致导线的阻抗发生变化。而过孔和树桩对阻抗的影响，往往是设计者容易忽略的问题。
要选择合理尺寸的过孔大小。比如对4层到10层的PCB设计来说，常见的选择为10mil／20mil（钻孔／焊盘）或16mil／30mil的过孔较好，对于一些高密度的小尺寸的PCB，也可以使用8mil／18mil的过孔。对电源或地线的过孔可以考虑用较大尺寸，以减少阻抗。电源和地的管脚要就近放置过孔，过孔和管脚之间的引线越短越好，同时，电源和地的引线要尽可能粗，以减少阻抗。
