通常２４位ＡＤＣ都会产生一个微小的直流偏移，在ＣＳ５３８１内部有一个数字高通滤波器，可以通过给管脚ＨＰＦ提供一个低电平使该滤波器有效，这样，芯片可以消除直流偏移。另外芯片还带有溢流监测器，当模拟信号的输入电压幅度过大而致使ＡＤＣ转换溢出时，相对应的管脚ＬＦＶ变低，因此，在该管脚与电源之间接一个发光二极管，就可以直观地显示出模拟输入是否溢出，从而根据需要调整前端放大电路的增益。
ＣＳ５３８１的模拟信号为差动输入方式，因此，它的前端要有一个简单的模拟调理电路。ＣＳ５３８１的转换结果是２４位补码形式的串行数据，且左右通道交替输出，可用ＬＲＣＫ的高低电平来进行区分。输出数据有两种格式：左对齐和Ｉ２Ｓ。图２是ＣＳ５３８１的两种数据传输时序。
３、四通道并行采集系统的设计
图３所示是一个四通道并行采集系统的整体框图，该系统主要由ＴＭＳ３２０ＶＣ３３（以下简称ＶＣ３３）、两片ＣＳ５３８１、一片ＦＰＧＡ（ＥＰＦ１０Ｋ１０）和一个大容量ＦＩ-ＦＯ存储器构成。采集系统与主机的通讯采用ＵＳＢ接口。系统中的一片ＣＳ５３８１工作于主模式，另外一片则工作在从模式下，这样可以保证两片ＡＤＣ工作时严格同步。
在基于ＣＳ５３８１的采集系统中，如何实现ＣＳ５３８１与ＴＭＳ３２０ＶＣ３３的接口是一个关键问题。具体的设计方案有两种：其一，由于ＣＳ５３８１采用同步串行数据输出方式，而ＴＭＳ３２０ＶＣ３３具有多通道缓冲串口（ＭｃＢＳＰ），因此，可以较为容易地实现二者的硬件连接。其二是通过ＣＰＬＤ／ＦＰＧＡ设计串并转换电路，并把ＣＳ５３８１输出的串行数据转换为并行数据，然后由ＴＭＳ３２０ＶＣ３３通过扩展ＩＯ对数据进行读取。这两种方案相比，第一种方案比较简单，但系统要设计四个独立的同步采集通道，并要使用两片ＣＳ５３８１，而ＴＭＳ３２０ＶＣ３３只有一个ＭｃＢＳＰ，所以此方案无法采用。第二种方案实现起来相对比较麻烦，硬件成本也较大。它通过把每片ＣＳ５３８１的串行数据转换成８位并行数据并经ＦＩＦＯ缓存，然后由ＴＭＳ３２０ＶＣ３３通过中断和ＤＭＡ方式对四个通道的转换数据进行读取。
